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Thema: FET simulation mit Pspice

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  1. #1
    Benutzer Stammmitglied
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    FET simulation mit Pspice

    Hallo,

    ich habe folgende Schaltung (siehe Anhang). Der FET ist ein P-Kanal, selbstsperrend. Das heisst doch, wenn ich am Gate 0V oder eine positve Spannung habe, muesste ich an Drain volle 5V (+Us) messen. Leider werden es nie mehr als 0.6-0.7V , egal welchen P-Kanal MOSFET ich nehme und welche Spannung ich am Gate hab, der MOSFET scheint nie komplett zu sperren. Mit N-Kanal ist alles kein Problem, die funktionieren in der Simulation so wie ich es erwarte. Mache ich jetzt einen Denkfehler oder ist die Simulation fuer den Ars..?

    gruss
    kristian
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